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IC 驗(yàn)證經(jīng)理

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  • 48萬(wàn)-90萬(wàn)/年
  • 上海
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  • 5年以上
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  • 碩士
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  • 全職

職位誘惑: 五險(xiǎn)一金,福利好,老板nice,技術(shù)領(lǐng)先,成長(zhǎng)空間大

發(fā)布時(shí)間: 2021-06-17發(fā)布

職位描述


崗位職責(zé):
1、 根據(jù)設(shè)計(jì)文檔提交驗(yàn)證計(jì)劃,制定模塊的驗(yàn)證方案,建立驗(yàn)證環(huán)境及驗(yàn)證框架,完成模塊級(jí)和芯片級(jí)驗(yàn)證;
2、 執(zhí)行回歸測(cè)試,提升驗(yàn)證的覆蓋率;
3、 協(xié)助 FPGA 工程師和軟件工程師完成 FPGA 原型測(cè)試;
4、 配合芯片設(shè)計(jì)工程師查找修復(fù)設(shè)計(jì)缺陷;
5、 確認(rèn)芯片設(shè)計(jì)的完整性,指導(dǎo)設(shè)計(jì)部門實(shí)現(xiàn)可驗(yàn)證設(shè)計(jì)流程;
6、 完成門級(jí)仿真、帶UPF的形式驗(yàn)證等工作,確保芯片流片成功。
 
任職資格:
1、 本科及以上學(xué)歷,計(jì)算機(jī)/電子工程/通信工程等相關(guān)專業(yè);
2、 微電子學(xué),電子工程等相關(guān)專業(yè)碩士及其以上學(xué)歷,5年以上IC驗(yàn)證從業(yè)經(jīng)驗(yàn)
3、 熟悉數(shù)字芯片 SoC 和通信模塊原理;
4、 熟悉 Verilog,精通 C / System Verilog 驗(yàn)證;
5、 掌握 Python/Perl / Shell / Tcl 等腳本;
6、 有帶領(lǐng)團(tuán)隊(duì)或Start-up公司經(jīng)驗(yàn)優(yōu)先
7、 有存儲(chǔ)器驗(yàn)證經(jīng)驗(yàn)優(yōu)先
8、 熟悉 VMM / UVM 者優(yōu)先。

職位發(fā)布者

盧原

聯(lián)合創(chuàng)始人/CEO/公司高管

7天

簡(jiǎn)歷處理用時(shí)

100%

簡(jiǎn)歷及時(shí)處理率

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